集成电路设计企业增值税加计抵减政策简介
为了促进集成电路产业的高质量发展，财政部，税务总局发布了关于集成电路企业增值税加计抵减政策的通知。为了提供给集成电路客户税务方面的支持，启源总结整理了关于集成电路设计企业的增值税加计抵减的相关政策以供客户参考。
一、 集成电路企业的加计抵减政策
自2023年1月1日至2027年12月31日，允许集成电路设计、生产、封测、装备、材料企业，按照当期可抵扣进项税额加计15%抵减应纳增值税税额。
二、 享受增值税加计抵减政策的集成电路设计企业的条件
集成电路设计企业，必须同时满足以下条件，才可享受加计抵减政策。
- 在中国境内（不包含港、澳、台地区）依法设立，从事集成电路设计、电子设计自动化（EDA）工具开发或知识产权（IP）核设计并具有独立法人资格的企业；
- 企业为增值税一般纳税人；
- 申请优惠政策的上一年度，企业具有劳动合同关系或劳务派遣、聘用关系的研究开发人员月平均数占企业月平均职工总数的比例不低于40%；
- 企业拥有核心关键技术和属于本企业的知识产权，并以此为基础开展经营活动，且申请优惠政策的上一年度，研究开发费用总额占企业销售（营业）收入（主营业务收入与其他业务收入之和）总额的比例不低于6%；
- 申请优惠政策的上一年度，集成电路设计（含EDA工具、IP和设计服务）销售（营业）收入占企业收入总额的比例不低于60%，其中自主设计销售（营业）收入占企业收入总额的比例不低于50%，且企业收入总额不低于（含）3000万元；
- 申请优惠政策的上一年度未发生重大安全、重大质量事故或严重环境违法行为。
三、 享受增值税加计抵减政策需注意的事项
集成电路设计企业按照当期可抵扣进项税额的15%计提当期加计抵减额。企业外购芯片对应的进项税额，以及按照现行规定不得从销项税额中抵扣的进项税额，不得计提加计抵减额；已计提加计抵减额的进项税额，按规定作进项税额转出的，应在进项税额转出当期，相应调减加计抵减额。
集成电路设计企业可计提但未计提的加计抵减额，可在确定适用加计抵减政策当期一并计提。
集成电路设计企业出口货物劳务、发生跨境应税行为不适用加计抵减政策，其对应的进项税额不得计提加计抵减额。
集成电路设计企业兼营出口货物劳务、发生跨境应税行为且无法划分不得计提加计抵减额的进项税额，按照以下公式计算：
不得计提加计抵减额的进项税额=当期无法划分的全部进项税额*当期出口货物劳务和发生跨境应税行为的销售额/当期全部销售额
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